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CHAPTER 3 CPU FUNCTION
User’s Manual U15905EJ2V1UD
57
(1) Interrupt status saving registers (EIPC and EIPSW)
EIPC and EIPSW are used to save the status when an interrupt occurs.
If a software exception or a maskable interrupt occurs, the contents of the program counter (PC) are saved to
EIPC, and the contents of the program status word (PSW) are saved to EIPSW (these contents are saved to
the NMI status saving registers (FEPC and FEPSW) if a non-maskable interrupt occurs).
The address of the instruction next to the one of the instruction under execution, except some instructions, is
saved to EIPC when a software exception or a maskable interrupt occurs.
The current contents of the PSW are saved to EIPSW.
Because only one set of interrupt status saving registers is available, the contents of these registers must be
saved by program when multiple interrupts are enabled.
Bits 31 to 26 of EIPC and bits 31 to 8 of EIPSW are reserved for future function expansion (these bits are
always fixed to 0).
31
0
EIPC
(Contents of PC)
0
Default value
0xxxxxxxH
(x: Undefined)
26 25
0 0 0 0
31
0
EIPSW
(Contents of PSW)
0
Default value
000000xxH
(x: Undefined)
87
0 0 0 0
0
0 0 0 0
0
0 0 0 0
0
0 0 0 0
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